Giovanni Brignone

Dottorando in Ingegneria Elettrica, Elettronica E Delle Comunicazioni , 37^o cycle (2021-2024)
Dipartimento di Elettronica e Telecomunicazioni (DET)

giovanni.brignone@polito.it

Profilo

Dottorato di ricerca

Argomento di ricerca

Improving Quality of Results for HLS designs

Tutori

Luciano Lavagno

Interessi di ricerca

Modeling, simulation and CAD

Biografia

Giovanni Brignone received the M.S. degree in Computer Engineering from the Politecnico di Torino (Italy) in 2021, where he is currently pursuing the Ph.D. degree with the Department of Electronics and Telecommunications under the supervision of Prof. L. Lavagno.
His research interests focus on high-level synthesis, digital hardware design, and HW/SW co-design.

Pubblicazioni

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Brignone, Giovanni; Lazarescu, Mihai T.; Lavagno, Luciano (In stampa)
A DSP shared is a DSP earned: HLS Task-Level Multi-Pumping for High-Performance Low-Resource Designs. In: IEEE International Conference on Computer Design, Washington (USA), 6/11/2023 - 8/11/2023
Contributo in Atti di Convegno (Proceeding)
Brignone, Giovanni; Jamal, Muhammad Usman; Lazarescu, Mihai T.; Lavagno, Luciano (2022)
Array-specific dataflow caches for high-level synthesis of memory-intensive algorithms on FPGAs. In: IEEE ACCESS, vol. 10, pp. 118858-118877. ISSN 2169-3536
Contributo su Rivista